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      電子發(fā)燒友網(wǎng)>電子資料下載>傳感與控制>基于AXI總線的RapidIO端口控制器IP核的設(shè)計(jì)方法

      基于AXI總線的RapidIO端口控制器IP核的設(shè)計(jì)方法

      2017-11-01 | rar | 0.84 MB | 次下載 | 免費(fèi)

      資料介紹

      　　現(xiàn)代數(shù)字信號(hào)處理技術(shù)的發(fā)展，要求系統(tǒng)高速并實(shí)時(shí)傳輸大量數(shù)據(jù)，這對(duì)傳輸數(shù)據(jù)總線提出了更高的要求。Rapidl0這種高速串行總線具有帶寬高、延時(shí)低的特點(diǎn)，為嵌入式系統(tǒng)內(nèi)部互聯(lián)通信提供了良好的解決方案。另一方面，高速串行總線的應(yīng)用又對(duì)數(shù)據(jù)存儲(chǔ)提出了更高的要求，如何更高效實(shí)時(shí)的進(jìn)行數(shù)據(jù)存儲(chǔ)成為了新的研究方向。固態(tài)存儲(chǔ)這種完全采用半導(dǎo)體芯片作為數(shù)據(jù)存儲(chǔ)介質(zhì)和讀取機(jī)構(gòu)的存儲(chǔ)形式，摒棄了磁盤物理和機(jī)械特性的缺陷?；诖耍驹O(shè)計(jì)采用Rapidl0總線結(jié)構(gòu)和mSATA固態(tài)硬盤，提出了一種基于VPX標(biāo)準(zhǔn)的存儲(chǔ)模塊設(shè)計(jì)方案。

      基于AXI總線的RapidIO端口控制器IP核的設(shè)計(jì)方法

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