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      電子發(fā)燒友網(wǎng)>電子資料下載>電子教材>飛思卡爾SSI模塊培訓(xùn)資料

      飛思卡爾SSI模塊培訓(xùn)資料

      2011-03-25 | pdf | 259 KB | 次下載 | 免費(fèi)

      資料介紹

      Independent or shared transmit and receive sections with separate
      or shared internal/external clocks and frame syncs, operating in
      master or slave mode
      Normal mode with frame sync
      Network mode allowing multiple devices to share the port with as
      many as 32 time slots
      Gated clock mode with no frame sync
      TM Freescale Semiconductor Confidential and Proprietary Information. Freescale. and the Freescale logo are trademarks
      of Freescale Semiconductor, Inc. All other product or service names are the property of their respective owners. . Freescale Semiconductor, Inc. 2006.
      2 sets of transmit and receive FIFOs, each is 15x32bits
      Programmable data interface mode: I2S, lsb or msb-aligned
      Programmable word length (8,10,12,16,18,20,22 or 24bits)
      AC97 support
      Transmit and receive time slot mask registers for reduced CPU
      overhead

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