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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>哈工大四系FPGA上機(jī)實(shí)驗(yàn)編程部分

      哈工大四系FPGA上機(jī)實(shí)驗(yàn)編程部分

      2017-10-20 | doc | 2462KB | 次下載 | 免費(fèi)

      資料介紹

      哈工大四系FPGA上機(jī)實(shí)驗(yàn)編程部分

      　　請根據(jù)要原理圖實(shí)現(xiàn)的功能，把代碼完整寫在此處，要求無語法錯誤。

      　　module aa（A，CLK，B，C）;

      　　input A;

      　　input CLK;

      　　output reg B，C;

      　　reg D，K;

      　　always@ （posedge CLK）

      　　begin

      　　D《=A;

      　　K=D&&A;

      　　C《=K;

      　　B《=D;

      　　end

      　　endmodule

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