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DDR3 SDRAM使用雙倍數(shù)據(jù)速率架構(gòu)來(lái)實(shí)現(xiàn)高速操作。雙倍數(shù)據(jù)速率結(jié)構(gòu)是一種8n預(yù)取架構(gòu)，其接口經(jīng)過(guò)設(shè)計(jì)，可在I/O引腳上每個(gè)時(shí)鐘周期傳輸兩個(gè)數(shù)據(jù)字。DDR3 SDRAM的單個(gè)讀或?qū)懖僮饔行У匕▋?nèi)部DRAM核心處的單個(gè)8n位寬的四時(shí)鐘周期數(shù)據(jù)傳輸和I/O引腳處的八個(gè)相應(yīng)的n位寬、半時(shí)鐘周期數(shù)據(jù)傳送。
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