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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>異步FIFO和PLL在高速雷達數(shù)據(jù)采集系統(tǒng)中的應用

      異步FIFO和PLL在高速雷達數(shù)據(jù)采集系統(tǒng)中的應用

      2023-11-08 | pdf | 616.95KB | 次下載 | 免費

      資料介紹

      簡介：將異步FIFO和鎖相環(huán)應用到高速雷達數(shù)據(jù)采集系統(tǒng)中用來緩存A/D轉換的高速采樣數(shù)據(jù)，解決嵌入式實時數(shù)據(jù)采集系統(tǒng)中，高速采集數(shù)據(jù)量大，而處理器處理速度有限的矛盾，提高系統(tǒng)的可靠性。根據(jù)FPGA內(nèi)部資源的特點，將FIFO和鎖相環(huán)設計在一塊芯片上。因為未使用外掛FIFO和PLL器件，使得板卡設計結構簡單，并減少硬件板卡的干擾。由于鎖相環(huán)的使用，使得整個采集系統(tǒng)時鐘管理方便。異步FIFO構成的高速緩存具有一定通用性，方便系統(tǒng)進行升級維護。
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