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摘要：分析了“數(shù)字電路與邏輯設(shè)計(jì)”課程中“一般時(shí)序電路設(shè)計(jì)”的內(nèi)容的地位與作用，指出傳統(tǒng)教學(xué)方法在設(shè)計(jì)較復(fù)雜電路時(shí)的局限性，為此完善了教材對(duì)該部分內(nèi)容的講解，同時(shí)設(shè)計(jì)了一種基于Active—HDL6．1和QUARTUSII4．1軟件及可編程邏輯器件FPGA講授“一般時(shí)序電路設(shè)計(jì)”的教學(xué)方法，實(shí)踐證明該教學(xué)方法使用不多的課時(shí)就能讓學(xué)生輕松的掌握復(fù)雜數(shù)字系統(tǒng)電路的設(shè)計(jì)。
關(guān)鍵詞：一般時(shí)序電路設(shè)計(jì)；教學(xué)方法;Active—HDL6．1；QUARTUSII4．1;FPGA
關(guān)鍵詞：一般時(shí)序電路設(shè)計(jì)；教學(xué)方法;Active—HDL6．1；QUARTUSII4．1;FPGA
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