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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>模擬數(shù)字論文>利用擴(kuò)頻時(shí)鐘來(lái)降低EMI

      利用擴(kuò)頻時(shí)鐘來(lái)降低EMI

      2023-02-14 | pdf | 7.57 MB | 次下載 | 2積分

      資料介紹

      RF DAC的無(wú)雜散動(dòng)態(tài)范圍受到嚴(yán)重的數(shù)字do主開(kāi)關(guān)的限制，這會(huì)干擾模擬輸出信號(hào)。介紹了一種擴(kuò)頻時(shí)鐘發(fā)生器（SSCG）的設(shè)計(jì)、布局和仿真。SSCG調(diào)制用于切換DAC數(shù)字塊的時(shí)鐘頻率，以減少DAC模擬輸出信號(hào)處的電磁干擾（EMI）雜散。利用相位控制架構(gòu)而非傳統(tǒng)PLL，SCG系統(tǒng)被證明可以將分頻時(shí)鐘脈沖的頻譜高度降低到9.6dB。

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