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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>電源技術(shù)論文>數(shù)字頻率計(jì)設(shè)計(jì)方案

      數(shù)字頻率計(jì)設(shè)計(jì)方案

      2011-07-05 | doc | 407KB | 次下載 | 免費(fèi)

      資料介紹

      簡(jiǎn)易數(shù)字頻率計(jì)利用復(fù)雜可編程邏輯器件FPGA,VHDL編程將所有功能模塊集成在一塊芯片上。功能模塊包括時(shí)基脈沖發(fā)生器、計(jì)數(shù)器、數(shù)據(jù)鎖存器和顯示電路4部分。設(shè)計(jì)時(shí)先分別設(shè)計(jì)各功能模塊，并調(diào)試得到正確仿真結(jié)果，然后將各個(gè)功能模塊組合起來(lái)。最后作整體仿真、下載，得到實(shí)物。由于采用純數(shù)字硬件設(shè)計(jì)制作，穩(wěn)定性、可靠性遠(yuǎn)遠(yuǎn)高于使用單片機(jī)或模擬方式實(shí)現(xiàn)的系統(tǒng)，外圍電路簡(jiǎn)單。該數(shù)字頻率計(jì)達(dá)到預(yù)期要求，實(shí)現(xiàn)了可變量程測(cè)量，測(cè)量范圍0.1Hz—9999MHz，精度可達(dá)0.1Hz。

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