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• 實(shí)現(xiàn)信號(hào)CDMA調(diào)制/解調(diào)的水聲通信系統(tǒng)

  任何信息需要借助聲、光、電信 號(hào)進(jìn)行傳遞，由于光信號(hào)和電信號(hào)在海水中的衰減比較嚴(yán)重，而聲波是人類迄今為止已知的惟一能在水中遠(yuǎn)距離傳播的能量形勢(shì)，因此，近些年海洋中的水聲通信系統(tǒng)的研究以及開發(fā)成了熱點(diǎn)。...

  2409次閱讀 · 0評(píng)論 fpgacdma解調(diào)
  

• 以FPGA作為硬件核心部分的自動(dòng)溫度采集控制系統(tǒng)設(shè)計(jì)淺析

  隨著當(dāng)前工業(yè)控制自動(dòng)化日益普及，對(duì)于工作環(huán)境中的溫度控制也越來越重要。本設(shè)計(jì)即是針對(duì)某些需要持續(xù)恒溫的特殊環(huán)境而設(shè)計(jì)的自動(dòng)溫度采集控制系統(tǒng)。該系統(tǒng)采用FPGA作為硬件核心部分，有效地利用FPGA在可編程門陣列方面的優(yōu)點(diǎn)，最大限度的使硬件電路軟件化，減少了可視硬件的規(guī)模，降低了硬件加工、布線以及元器件...

  3319次閱讀 · 0評(píng)論 FPGA控制系統(tǒng)
  

• 如何區(qū)分FPGA與CPLD？本文告訴你答案！

  如何區(qū)分CPLD或FPGA和哪一個(gè)更適合自己？這是一個(gè)老生常談的問題，尤其是學(xué)生和初學(xué)者。如果您也在這個(gè)問題上很迷茫，那么就請(qǐng)聽小編為您區(qū)分FPGA與CPLD。...

  2470次閱讀 · 0評(píng)論 FPGACPLD
  

• 基于FLASH和反熔絲技術(shù)的FPGA你知道多少

  ProASICPLUS系列FPGA采用第二代基于FLASH技術(shù)的0.22μm標(biāo)準(zhǔn)CMOS工藝，是一種單芯片解決方案，無需外部配置器件，上電即能運(yùn)行而且斷電之后能夠保存配置代碼。它具有較低的功耗和高性能的布線結(jié)構(gòu)。...

  10456次閱讀 · 0評(píng)論 fpgaflash
  

• 六種Python字符串拼接方法，你知道幾種

  第一種，有編程經(jīng)驗(yàn)的人，估計(jì)都知道很多語言里面是用加號(hào)連接兩個(gè)字符串，Python里面也是如此直接用“+”來連接兩個(gè)字符串；...

  3844次閱讀 · 0評(píng)論 字符串python

• FPGA該如何應(yīng)對(duì)ASIC的大爆發(fā)？

  有人認(rèn)為，除了人才短缺、開發(fā)難度較大，相比未來的批量化量產(chǎn)的ASIC芯片，F(xiàn)PGA在成本、性能、功耗方面仍有很多不足。這是否意味著，在ASIC大爆發(fā)之際，F(xiàn)PGA將淪為其“過渡”品的命運(yùn)？...

  1204次閱讀 · 0評(píng)論 FPGAASIC

• 基于CAM關(guān)聯(lián)比較器的FPGA雷達(dá)脈沖預(yù)分選器設(shè)計(jì)

  對(duì)CAM和RAM單元的初始化數(shù)據(jù)寫入既可預(yù)先初始化，也可在系統(tǒng)工作過程中實(shí)時(shí)更新。在雷達(dá)信號(hào)預(yù)分選應(yīng)用中可將已知輻射源庫利用初始化內(nèi)存文件對(duì)CAM和RAM進(jìn)行初始化。對(duì)未知輻射源參數(shù)可在系統(tǒng)工作過程中實(shí)時(shí)動(dòng)態(tài)寫入。...

  1895次閱讀 · 0評(píng)論 fpga雷達(dá)cam
  

• 可同步于GPS的FPGA恒溫晶振頻率校準(zhǔn)系統(tǒng)設(shè)計(jì)

  設(shè)計(jì)中使用四路選通器分別連接計(jì)數(shù)器模塊、延遲線模塊和FIFO緩沖的輸出，其中因計(jì)數(shù)器模塊中采用16位的計(jì)數(shù)器循環(huán)計(jì)數(shù)，為了與PicoBlaze輸入匹配，須將計(jì)數(shù)值分兩部分接到選通器。異步串行控制器的輸出和狀態(tài)信息分別接到三路選通器，剩余一路連接四路選通器的輸出。由于UART和PicoBlaze使用的...

  2546次閱讀 · 0評(píng)論 fpgagps晶振
  

• 以FPGA為核心的高速通信系統(tǒng)設(shè)計(jì)

  通過測(cè)試，此組傳輸器件可以驅(qū)動(dòng)LVDS信號(hào)通過SVY-50-3型號(hào)電纜傳輸至少200 m。信號(hào)經(jīng)過傳輸后，在電纜末端衰減嚴(yán)重，噪聲和抖動(dòng)也較嚴(yán)重。此時(shí)信號(hào)眼圖如圖3所示，可以看出信號(hào)質(zhì)量差。直接接收此信號(hào)，會(huì)產(chǎn)生信號(hào)電平誤判，而且信號(hào)的抖動(dòng)將導(dǎo)致后級(jí)電路無法正常工作。接收均衡器CLC012自動(dòng)為信號(hào)...

  4333次閱讀 · 0評(píng)論 fpga驅(qū)動(dòng)器通信系統(tǒng)
  

• 以FPGA控制為核心的LED漢字滾動(dòng)顯示器設(shè)計(jì)

  上述各模塊分別在QualtusⅡ中通過了仿真驗(yàn)證，最后對(duì)整體設(shè)計(jì)進(jìn)行了硬件驗(yàn)證。將設(shè)計(jì)載入KH31001開發(fā)板的Cyclone工系列EPlC6Q-240C8FPGA器件中，實(shí)驗(yàn)證明漢字滾動(dòng)顯示掃描情況均正常，能夠按照預(yù)想進(jìn)行移位顯示，這說明。FPGA的內(nèi)核硬件工作良好，可以正確地實(shí)現(xiàn)所要求的設(shè)計(jì)功能...

  2136次閱讀 · 0評(píng)論 fpgaled顯示器
  

• 利用FPGA固有特性的遠(yuǎn)程監(jiān)控系統(tǒng)設(shè)計(jì)

  根據(jù)定時(shí)器的定時(shí)信息和命令寄存器的命令，控制計(jì)數(shù)器對(duì)α測(cè)量模塊傳過來的脈沖信號(hào)進(jìn)行計(jì)數(shù)，從而獲得輻射總量的計(jì)數(shù)值，該計(jì)數(shù)值被存進(jìn)FIFO中；而在另一側(cè)，NiosIICPU通過Avalon總線向IP核的命令寄存器寫入相應(yīng)的命令字實(shí)現(xiàn)對(duì)各通道的控制，例如啟動(dòng)總量計(jì)數(shù)、關(guān)閉總量計(jì)數(shù)、設(shè)置采集時(shí)間及清空FI...

  1041次閱讀 · 0評(píng)論 fpga通信監(jiān)控系統(tǒng)
  

• 利用FPGA開發(fā)的太陽能自動(dòng)跟蹤系統(tǒng)設(shè)計(jì)

  當(dāng)時(shí)間為正常光照時(shí)間時(shí)，太陽跟蹤系統(tǒng)每隔5 min就會(huì)進(jìn)入太陽高度角方位角進(jìn)行計(jì)算。計(jì)時(shí)模塊輸出給太陽高度角方位角模塊所需的時(shí)間信息，然后計(jì)算赤道坐標(biāo)系下的赤緯角和時(shí)角，最后計(jì)算高度角方位角坐標(biāo)系下的高度角和方位角值，并輸出高度角和方位角值如圖6所示，仿真波形如圖7所示。高度角和方位角輸出均為10 ...

  1281次閱讀 · 0評(píng)論 fpga脈沖步進(jìn)電機(jī)

• 利用ADS5500的FPGA1024點(diǎn)的數(shù)字脈沖壓縮系統(tǒng)設(shè)計(jì)

  在數(shù)字信號(hào)處理系統(tǒng)中，數(shù)據(jù)表示格式可分為定點(diǎn)制、浮點(diǎn)制和塊浮點(diǎn)制，它們?cè)趯?shí)現(xiàn)時(shí)對(duì)系統(tǒng)資源的要求不同，工作速度也不同，有著不同的適用范圍。定點(diǎn)表示法使用最多，簡(jiǎn)單且速度快，但動(dòng)態(tài)范圍有限，需要用合適的溢出控制規(guī)則(如定比例法)適當(dāng)壓縮輸入信號(hào)的動(dòng)態(tài)范圍，但這樣會(huì)降低輸出信號(hào)的信噪比。浮點(diǎn)表示法的優(yōu)點(diǎn)是...

  1374次閱讀 · 0評(píng)論 fpga脈沖數(shù)字信號(hào)
  

• 以FPGA控制為核心的NRF905無線通信系統(tǒng)設(shè)計(jì)

  系統(tǒng)建立起來后，下一步是最終的板級(jí)驗(yàn)證。圖6為用Chipscope得到的波形圖。mosi與miso分別是發(fā)送端與接收端SPI總線上的信號(hào)。從圖中可以看出數(shù)據(jù)基本吻合，由此表明設(shè)計(jì)的以FPGA控制NRF905的無線通信系統(tǒng)能夠正常工作。 ...

  2075次閱讀 · 0評(píng)論 fpga無線通信系統(tǒng)
  

• 一種以FPGA為基礎(chǔ)的多路模擬信號(hào)自適應(yīng)采集系統(tǒng)設(shè)計(jì)

  目前，在PCM／FM遙測(cè)體系中模擬信號(hào)采集普遍采用8位量化，全部模擬信號(hào)均歸一化到O～5 V范圍內(nèi)，隨著需要采集的模擬信號(hào)的類型多樣化，勢(shì)必增加信號(hào)調(diào)理電路的多樣性，不利于系統(tǒng)的簡(jiǎn)化和模塊化。在量化位數(shù)一定的系統(tǒng)中，被衰減處理的信號(hào)中實(shí)際量化誤差等于N倍（N是信號(hào)被衰減的倍數(shù)）的最小量化誤差，因此...

  2319次閱讀 · 0評(píng)論 FPGA模擬信號(hào)
  

• 以FPGA為核心控制的電子設(shè)計(jì)競(jìng)賽電路板設(shè)計(jì)和實(shí)現(xiàn)

  大學(xué)生電子競(jìng)賽題目以模擬電子、數(shù)字電子、可編程邏輯器件及單片機(jī)技術(shù)為核心， 涉及電子儀器儀表、通信、高頻無線電、自動(dòng)控制等多學(xué)科內(nèi)容。2007 年電子設(shè)計(jì)競(jìng)賽組委會(huì)專家指出： 電子設(shè)計(jì)競(jìng)賽的發(fā)展趨勢(shì)將以模電、數(shù)電、FP2GA 為重點(diǎn)。因此， 對(duì)于參賽隊(duì)員來說要獲得較好的成績(jī)， 選擇合適的題目并進(jìn)行培...

  4272次閱讀 · 0評(píng)論 fpga放大器單片機(jī)
  

• 以FPGA為核心的純數(shù)字真隨機(jī)數(shù)發(fā)生器設(shè)計(jì)與實(shí)現(xiàn)

  其中n是輸入序列的個(gè)數(shù)，bi是每個(gè)序列的偏置。容易看出b≤bi（1≤i≤n），等式當(dāng)且僅當(dāng)在bi=0（）或者bi=1/2（）時(shí)成立。簡(jiǎn)而言之，異或運(yùn)算顯著地減小了獨(dú)立輸入序列的偏置。假設(shè)n=16且所有bi=1/3，那么b=0.000 761可以忽略不計(jì)。...

  6650次閱讀 · 0評(píng)論 fpga振蕩器發(fā)生器
  

• 以FPGA為控制核心的程控濾波器設(shè)計(jì)

  方案1：數(shù)字電位器控制兩級(jí)INA129級(jí)聯(lián)。用FPGA控制數(shù)字電位器DS1267使其輸出不同的阻值，作為高精度儀表放大器INA129的反饋電阻。通過控制數(shù)字電位器來改變INA129的放大倍數(shù)，從而實(shí)現(xiàn)放大器的增益可調(diào)。...

  2584次閱讀 · 0評(píng)論 fpga濾波器控制
  

• 以FPGA機(jī)載為核心的實(shí)時(shí)視頻圖形處理系統(tǒng)設(shè)計(jì)

  結(jié)合系統(tǒng)需求，確定系統(tǒng)的總體設(shè)計(jì)方案為：以Xilinx公司的Virtex-5 XC5VFX70T FPGA為核心處理器，利用其強(qiáng)大邏輯資源和豐富的IP核，配以相應(yīng)的外部電路，構(gòu)建出一個(gè)靈活、簡(jiǎn)潔、可靠的機(jī)載視頻圖形處理系統(tǒng)的嵌入式硬件模塊。利用XC5VFX707T中內(nèi)嵌的Power PC 440硬核...

  2658次閱讀 · 0評(píng)論 處理器fpgadvi
  

• 怎樣利用FPGA設(shè)計(jì)一個(gè)跨時(shí)鐘域的同步策略？

  觸發(fā)器是FPGA設(shè)計(jì)中最常用的基本器件。觸發(fā)器工作過程中存在數(shù)據(jù)的建立（setup）和保持（hold）時(shí)間。對(duì)于使用上升沿觸發(fā)的觸發(fā)器來說，建立時(shí)間就是在時(shí)鐘上升沿到來之前，觸發(fā)器數(shù)據(jù)端數(shù)據(jù)保持穩(wěn)定的最小時(shí)間。而保持時(shí)間是時(shí)鐘上升沿到來之后，觸發(fā)器數(shù)據(jù)端數(shù)據(jù)還應(yīng)該繼續(xù)保持穩(wěn)定的最小時(shí)間。我們把這段時(shí)...

  2102次閱讀 · 0評(píng)論 fpga信號(hào)觸發(fā)器
  
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